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带有48字节RAM的日历时钟芯片的设计
The logic design of a clock/calendar IC with 48°i8bit RAM

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作　　者： ; ; ; ;

机构地区： 华南理工大学电子与信息学院

出　　处： 《电子技术应用》 2005年第6期73-76,共4页

摘　　要： 介绍了一种带有48字节RAM的日历时钟芯片的设计,该芯片具有振荡、分频、可编程的计时计数、定时闹响和中断输出等功能。该芯片基于VerilogHDL描述,采用模块化设计,可扩展性好;并利用Synopsys公司的VCS和DC工具分别对设计进行了成功的系统仿真和综合;同时还简单介绍了ASIC设计的整个流程。

关键词： 日历时钟芯片字节公司设计模块化设计可扩展性系统仿真可编程计时中断

领　　域： [自动化与计算机技术] [自动化与计算机技术] [机械工程] [机械工程] [机械工程]

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